Eclipse NiosIIのプロジェクトと相対パス

Eclipse NiosIIのプロジェクトと相対パス

Eclipse NiosIIのプログラム開発で、プロジェクトとは別のディレクトリに存在するソースコードをリンクする場合のメモです。 1. ...

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Spartan-3とZynq-7000を搭載したボードの消費電力比較

Spartan-3とZynq-7000を搭載したボードの消費電力比較

元々Spartan-3で実装していたシステムをZynq-7000のシステムに移植しました。消費電力が気になったので、2つのシステムの比較を行...

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Quartus IIで回路を更新した後のEclipseのコンパイル

Quartus IIで回路を更新した後のEclipseのコンパイル

Nios IIなどのCPUを含むシステム・デザインの場合、Quartus IIで回路データを更新した後にEclipseでプログラムの再コンパ...

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Quartus IIのVerilogインクルード・ディレクトリの指定方法

Quartus IIのVerilogインクルード・ディレクトリの指定方法

Verilogはdefineマクロなどを格納した別ファイルをインクルードできます。 Quartus IIでこのようなVerilogファ...

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SDカードからZedboardをブート

SDカードからZedboardをブート

ZedboardをSDカードからブートする方法のメモです。 用意するもの 既にUSB-JTAG経由で動作確認の終わっているVivadoプ...

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Vivado ロジックアナライザの実行手順

Vivado ロジックアナライザの実行手順

Vivadoでビルドインのロジックアナライザを使ってデバッグする場合の手順です。 1. Vivadoのプロジェクトを準備する デバッグを...

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Vivadoのマルチスレッド数を変えると速くなるか

Vivadoのマルチスレッド数を変えると速くなるか

Vivadoはツールが使用するマルチスレッドの最大数を変更できます。マニュアルによると、マルチスレッドのデフォルト値はWindowsが2でL...

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yosysで論理合成

yosysで論理合成

ANDやORといった基本ゲートで構成されたネットリストを生成したくて、yosysを試してみました。yosysはフリー(ISC license...

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挑戦!OpenCoresにIPコアを登録(その3)

挑戦!OpenCoresにIPコアを登録(その3)

OpenCoresではWISHBONEバスが奨励されているので、IPコアの外部バスをオリジナルの仕様からWISHNBONEバスに変更しました...

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Icarus VerilogのVPI

Icarus VerilogのVPI

VPIを使うと、自作のC関数をVerilog環境にtaskとして追加できます。Icarus VerilogにVPIでtaskを追加してシミュ...

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